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Liu
2023-03-17 21:48:27如何调用LVDS接口原语？官方回复：TD软件对于LVDS的支持不是通过原语来实现的，在.v/.hdl文件顶层和单端IO一样，在ADC引脚文件约束中选定P管脚对应的电平为LVDS/LVDS-E，TD软件会自动约束对应的N端管脚。
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罗仁昌
2023-03-05 13:43:42PH1A100器件中，serdes ip手册中对支持的线速是给出来几个线速范围，但是td5.6的软件中可以任意的设置线速率，不知道设置线速率3.1104G能否实现呢？官方回复：
，根据SERDES UG文档描述，您提到的3.1104G是在支持速率范围的。 -
arvin
2023-02-27 15:09:02TD软件可以实现批处理烧录吗官方回复：
您好，可以实现的。在使用软件下载时 td cosole会显示对应的tcl语句，可以对应的tcl语句做成一个脚本，然后通过命令行运行。
如附件是一个典型的批处理脚本参考。
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赵晨峰
2023-02-09 21:46:21如何正确配置引脚为差分输入？官方回复：
将差分管脚的P端在顶层设置为输入信号如：
input lvds_p,
约束该管脚lvds_p，选择电平标准为LVDS25\LVDS18等符合实际场景的标准
界面中可以看到差分对已经被自动绑定，约束完成后，用户逻辑直接将lvds_p作为单端信号使用即可
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Jiping chen
2023-02-07 20:00:17请问安路有原语吗官方回复：
安路科技针对不同系列器件提供了原语手册，方便用户例化使用，路径如下：
官网->服务支持->工具与资料下载->器件（如EF2）->使用指南->UG401_ELF2 Series FPGA Libraries Guide for HDL Designs
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yangtao
2023-02-07 16:18:22请问如何购买产品，可以提供哪些售后服务？官方回复：
参考官网->销售与经销商，咨询产品购买相关信息
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李旭
2022-12-29 17:10:59EG4系列芯片也支持syn_ip_flow的保护功能吗？是否和软件手册一样，在最后一步添加的是 al_map_basic.v？官方回复：
syn_ip_flow的功能不区分具体器件型号，由于软件版本差异可能导致生成的网表不兼容，所以建议添加al_map_basic.v补充网表中的原语
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孙学群
2022-10-24 16:12:55使用ef2l45lg144b的ADC模块其中的VREF引脚是不是必选？如果不选，参考电压是多少？ADC0和ADC1能不能公用一个参考？如果能，应该怎么操作？官方回复：
您好，如果使用ADC的话就必须使用外部VREF引脚。ADC0, ADC1的VREF引脚是独立提供的，不能共用一个。
400-9268-368