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FIFO IP是使用了BRAM块内嵌的硬件FIFO控制硬核，不需要额外消耗LUT资源；

RAMFIFO IP的FIFO控制器是由LUT资源搭建的，属于软核，该IP主要为了解决FIFO IP没有引出指示FIFO中还有多少数据的rdusedw、wrusedw参数。

可以使用cea信号作为wren使用。